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Virtex-6 FPGA Data Sheet: DC and Switching Characteristics
Table 35: GTH Transceiver User Clock Switching Characteristics (1)
Symbol
F TXOUT
F RXOUT
F TXIN
F RXIN
Description
TXUSERCLKOUT maximum frequency
RXUSERCLKOUT maximum frequency
TXUSERCLKIN maximum frequency
RXUSERCLKIN maximum frequency
Conditions
16-bit data path
20-bit data path
32-bit data path
40-bit data path
64-bit data path
80-bit data path
64B/66B-bit data path
16-bit data path
20-bit data path
32-bit data path
40-bit data path
64-bit data path
80-bit data path
64B/66B-bit data path
-3
350
350
350
280
350
280
175
140
170
350
280
350
280
175
140
170
Speed Grade
-2
350
350
350
280
350
280
175
140
170
350
280
350
280
175
140
170
-1
323
323
323
258
323
258
162
129
157
323
258
323
258
162
129
157
Units
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
Notes:
1.
Clocking must be implemented as described in UG371 : Virtex-6 FPGA GTH Transceivers User Guide .
Table 36: GTH Transceiver Transmitter Switching Characteristics
Symbol
T RTX
T FTX
T LLSKEW
Description
TX Rise time
TX Fall time
TX lane-to-lane skew
Condition
20%–80%
80%–20%
within one GTH Quad
Min
–
–
–
Typ
50 (3)
50 (3)
–
Max
–
–
300
Units
ps
ps
ps
Transmitter Output Jitter (1)(2)
TJ 11.18
DJ 11.18
TJ 10.3125
DJ 10.3125
TJ 9.953
DJ 9.953
TJ 2.667
DJ 2.667
TJ 2.488
DJ 2.488
Total Jitter
Deterministic Jitter
Total Jitter
Deterministic Jitter
Total Jitter
Deterministic Jitter
Total Jitter
Deterministic Jitter
Total Jitter
Deterministic Jitter
11.181 Gb/s
10.3125 Gb/s
9.953 Gb/s
2.667 Gb/s
2.488 Gb/s
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
0.280
0.170
0.280
0.170
0.280
0.170
0.110
0.060
0.110
0.060
UI
UI
UI
UI
UI
UI
UI
UI
UI
UI
Notes:
1.
2.
3.
These values are NOT intended for protocol specific compliance determinations.
All jitter values are based on a bit-error ratio of 1e -12 .
Rise and fall times are specified at the transmitter package balls.
DS152 (v3.6) March 18, 2014
Product Specification
www.xilinx.com
21
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